雙倍數(shù)據(jù)率同步動(dòng)態(tài)隨機(jī)存取存儲(chǔ)器（英語(yǔ)：Double Data Rate Synchronous Dynamic Random Access Memory，簡(jiǎn)稱(chēng)DDR SDRAM）為具有雙倍數(shù)據(jù)傳輸率的SDRAM，其數(shù)據(jù)傳輸速度為系統(tǒng)時(shí)鐘頻率的兩倍，由于速度增加，其傳輸性能優(yōu)于傳統(tǒng)的SDRAM。DDR SDRAM 在系統(tǒng)時(shí)鐘的上升沿和下降沿都可以進(jìn)行數(shù)據(jù)傳輸。JEDEC為DDR存儲(chǔ)器設(shè)立速度規(guī)范，并分為以下兩個(gè)部分：按內(nèi)存芯片分類(lèi)和按內(nèi)存模塊分類(lèi)。

　　當(dāng)手機(jī)開(kāi)機(jī)時(shí)，CPU便傳出一個(gè)復(fù)位信號(hào)REST給字庫(kù)，使系統(tǒng)復(fù)位。再待CPU把字庫(kù)的讀寫(xiě)端，片選端選端后，CPU就可以從字庫(kù)內(nèi)取出指令，在CPU里運(yùn)算，譯碼，輸出各部分協(xié)調(diào)的工作命令，從而完成各自功能。字庫(kù)（FLASH）程序儲(chǔ)存器的軟件資料是通過(guò)數(shù)據(jù)交換端，地址交換端與微處理器進(jìn)行通訊的。CE（CS）端為字庫(kù)片選端，OE端為讀允許端，REST端為系統(tǒng)復(fù)位端，這四個(gè)控制端分別者是由CPU加以控制。

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　　五十年代末期，世界上出現(xiàn)了塊集成電路，它把許多晶體管等電子元件集成在一塊硅芯片上，使電子產(chǎn)品向更小型化發(fā)展。

　　集成電路從小規(guī)模集成電路迅速發(fā)展到大規(guī)模集成電路和超大規(guī)模集成電路，從而使電子產(chǎn)品向著高效能低消耗、高精度、高穩(wěn)定、智能化的方向發(fā)展。

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